Search Results (All Fields:"control", Display Type:"Objeto de aprendizaje", isMemberOf:"oaingeec:ing-elec-col-e986be1262dcf896f5680312.e08c816", Date:" [2006\-01\-01T00\:00\:00Z TO 2006\-12\-31T00\:00\:00Z] ")

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Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma Electronics Workbench 5.1 ó superior)  7.33 426 66
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 352 73
Circuito para realizar el control de calidad en una cadena de producción. (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 295 63
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 330 70
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 405 65
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 308 58
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 355 80
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos..1 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 373 63
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..2 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 328 57
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 346 67
Circuito para realizar el control de calidad en una cadena de producción. (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 287 52
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 391 67
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..4 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 347 78
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 375 90
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 303 69
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..3 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 374 63
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 376 66
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..1 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 383 75
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 351 53
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 345 57
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..1 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 348 79
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos..2 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 414 76
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 378 66
Oscilador en puente de Wien con control automático de la ganancia mediante un FET (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 759 129
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..1 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 367 76
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 347 70
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..1 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 335 74
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..2 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 378 81
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma Electronics Workbench 5.1 ó superior)  7.33 396 75
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..3 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 318 75
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..4 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 380 72
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos (Requiere Plataforma Electronics Workbench 5.1 ó superior)  7.33 412 72
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 421 85
Circuito para realizar el control de calidad en una cadena de producción. (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 310 66
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (Requiere Plataforma OrCAD 9.1 ó superior)  7.33 408 59
Oscilador en puente de Wien con control automático de la ganancia mediante un FET (Requiere Plataforma MicroCAP 9.0 ó superior)  7.33 1046 146