Implementación de filtros Fir en FPGA's

Bravo, I., Gardel, A., Hernández, A., Mateos, R., Meca, F.J. y Rivera, R.(14/0) .Implementación de filtros Fir en FPGA's. .En: . ()

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Nombre Descripción Tipo MIME Size
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Titulo Implementación de filtros Fir en FPGA's
Autor(es) Bravo, I.
Gardel, A.
Hernández, A.
Mateos, R.
Meca, F.J.
Rivera, R.
Materia(s) diseño
filtro
FIR de cuatro coeficientes
FPGA
implementación
Resumen El presente trabajo tiene como objeto, mostrar diversas alternativas implementadas en laboratorios de diseño electrónico con dispositivos FPGA’s (Field Programmable Gate Array), de las titulaciones de Ingeniería Técnica de Telecomunicación e Ingeniería Electrónica. Concretamente el artículo presente diversos enfoques en el diseño e implementación de filtros FIR de cuatro coeficientes. Se busca en todos los diseños realizados, estudiar los resultados obtenidos desde el punto de vista de recursos internos consumidos y de la máxima velocidad que se puede lograr.
Editor(es) Universidad de Alcalá de Henares
Fecha 14/07/2004
Formato application/pdf
Identificador ../papers/2004SP106.pdf
taee:congreso-2004-1137
Idioma es
Versión de la publicación publishedVersion
Nivel de acceso y licencia info:eu-repo/semantics/openAccess
http://creativecommons.org/licenses/by-nc-nd/4.0
Tipo de recurso conferenceObject
Tipo de acceso Acceso abierto

Tipo de documento: Ponencia de Congreso
Collections: Set de openaire
Set de ponencias
Congreso TAEE año 2004
Pósters P1
 
Versiones
Versión Tipo de filtro
Contador de citas: Google Scholar Search Google Scholar
Estadísticas de acceso: 672 Visitas, 1597 Descargas  -  Estadísticas en detalle
Creado: Fri, 02 Oct 2009, 05:30:46 CET