Utilización de SMARTMODELS para verificación de sistemas electrónicos digitales

Carballo, P.P., Escuela, A.M., Marrero, M. y Martín, M.C.(14/0) .Utilización de SMARTMODELS para verificación de sistemas electrónicos digitales. .En: . ()

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Nombre Descripción Tipo MIME Size
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Titulo Utilización de SMARTMODELS para verificación de sistemas electrónicos digitales
Autor(es) Carballo, P.P.
Escuela, A.M.
Marrero, M.
Martín, M.C.
Materia(s) 68HC11
ASIC
FPGA
PCB
práctica
simulación
SmartModel
Resumen Durante años, la verificación de placas de circuitos impresos (PCBs) se realizaba directamente sobre los prototipos diseñados, sin uns fase previa de simulación. Por lo que el éxito del diseño realizado dependía en mayor medida de la experiencia del diseñador y en muchos casos, pequeños o incluso, grandes errores hacía necesario el diseño de otra PCB con la consiguiente pérdida de tiempo y dinero. Con la incorporación al mercado de modelos de comportamiento ya creados de miles de componentes, se hacemos ventajoso el uso de una fase de simulación previa del diseño que confirme su correcto funcionamiento antes de enviar a fabricación dicha PCB
Editor(es) Universidad de Las Palmas de Gran Canaria
Fecha 14/02/2002
Formato application/pdf
Identificador ../papers/2002S2C04.pdf
taee:congreso-2002-1040
Idioma es
Versión de la publicación publishedVersion
Nivel de acceso y licencia info:eu-repo/semantics/openAccess
http://creativecommons.org/licenses/by-nc-nd/4.0
Tipo de recurso conferenceObject
Tipo de acceso Acceso abierto

 
Versiones
Versión Tipo de filtro
Contador de citas: Google Scholar Search Google Scholar
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Creado: Fri, 02 Oct 2009, 05:30:46 CET