Mapeado tecnológico, síntesis lógica y herramientas de CAD microelectrónico

Cañellas, N., Marsal, L.F., Pallarés, J. y Ramírez, J.L.(20/0) .Mapeado tecnológico, síntesis lógica y herramientas de CAD microelectrónico. .En: . ()

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Nombre Descripción Tipo MIME Size
S2A03.pdf /papers/1996S2A03.pdf application/pdf
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Titulo Mapeado tecnológico, síntesis lógica y herramientas de CAD microelectrónico
Autor(es) Cañellas, N.
Marsal, L.F.
Pallarés, J.
Ramírez, J.L.
Materia(s) CAD
desarrollo
mapeado
práctica
síntesis
Resumen Es importante que, para conseguir la total comprensión de los conceptos teóricos, el alumno pueda realizar ejercicios prácticos. Estos ejercicios serán más útiles si, de forma paralela, sirven para aclarar conceptos relacionados, acercar al alumno a un entorno industrial real e incentivar su interés por la asignatura. En la presente comunicación se describe una aplicación sencilla con una herramienta de CAD microelectrónico. En ella, el alumno tiene la posibilidad de ver como una misma función lógica puede presentar diversas realizaciones prácticas. Comprobará también que, las distintas formas de mapear esta función, presentan costes distintos en área y tiempo de retardo. Simultáneamente se iniciará en el uso de un gran entorno de diseño y podrá comprobar la utilidad de los nuevos lenguajes de descripción en alto nivel.
Editor(es) Universidad Rovira i Virgili
Fecha 20/09/1996
Formato application/pdf
Identificador ../papers/1996S2A03.pdf
taee:congreso-1996-1075
Idioma es
Versión de la publicación publishedVersion
Nivel de acceso y licencia info:eu-repo/semantics/openAccess
http://creativecommons.org/licenses/by-nc-nd/4.0
Tipo de recurso conferenceObject
Tipo de acceso Acceso abierto

Tipo de documento: Ponencia de Congreso
Collections: Set de openaire
Set de ponencias
Congreso TAEE año 1996
Software Educativo IV
 
Versiones
Versión Tipo de filtro
Contador de citas: Google Scholar Search Google Scholar
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Creado: Fri, 02 Oct 2009, 05:30:46 CET