Entorno de simulación y test para PLDs

Cañellas, N., Hurtado, F., Marsal, L.F., Pallarés, J. y Ramírez, J.L.(20/0) .Entorno de simulación y test para PLDs. .En: . ()

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Nombre Descripción Tipo MIME Size
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Titulo Entorno de simulación y test para PLDs
Autor(es) Cañellas, N.
Hurtado, F.
Marsal, L.F.
Pallarés, J.
Ramírez, J.L.
Materia(s) entorno
implementación
PLD
simulación
test
Resumen El objetivo final de todo diseño es su implementación y su correcto funcionamiento. En el caso de los PLDs, la verificación del correcto funcionamiento es muy importante dada la naturaleza de éstos dispositivos donde su funcionalidad no esta definida hasta que se programa. La problemática que se plantea entonces, es la realización de una serie de pruebas de test para verificar su correcto funcionamiento. El presente trabajo presenta un sistema de software-hardware de test para dispositivos lógicos programables (PLDs) . Esta herramienta esta pensada como soporte docente a las prácticas de PLDs que se realizan en el laboratorio de electrónica digital.
Editor(es) Universidad Rovira i Virgili
Fecha 20/09/1996
Formato application/pdf
Identificador ../papers/1996S2E02.pdf
taee:congreso-1996-1018
Idioma es
Versión de la publicación publishedVersion
Nivel de acceso y licencia info:eu-repo/semantics/openAccess
http://creativecommons.org/licenses/by-nc-nd/4.0
Tipo de recurso conferenceObject
Tipo de acceso Acceso abierto

Tipo de documento: Ponencia de Congreso
Collections: Set de openaire
Set de ponencias
Congreso TAEE año 1996
Enseñanza de Laboratorio III
 
Versiones
Versión Tipo de filtro
Contador de citas: Google Scholar Search Google Scholar
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Creado: Fri, 02 Oct 2009, 05:30:46 CET