Descripción VHDL de sumador paralelo con acarreo de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)

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Titulo Descripción VHDL de sumador paralelo con acarreo de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)
Autor(es) Santiago Emilio Acha Alegre ORG:Universidad de Burgos
Julio Pérez Martínez
Manuel Alonso Castro Gil
Miguel Angel Rioseras Gómez
Adolfo Hilario Caballero
Rafael Sebastián Fernández
Africa López-Rey García-Rojas
Francisco Mur Pérez
Fernando Yeves Gutiérrez
Juan Peire Arroba
Resumen Se trata del esquema de un circuito resuelto que se estudia en el Capítulo 7 de la bibliografía indicada.
Editor(es) RA-MA, S.A. Editorial y Publicaciones version:3.0
Fecha 2006
Formato application/x-orcad
Identificador /eca-digital/intro_log/espec/VHDL_OrCAD/Cap07/res/07vh0_08/vhdl/07vh0_08e.opj
http://62.204.194.45/fez/view/oaingeec:digi-intro-espec-res-1291
oaingeec:digi-intro-espec-res-1291
Idioma es
Nivel de acceso y licencia Reconocimiento: http://creativecommons.org/licenses/by/3.0/deed.es
Attribution: http://creativecommons.org/licenses/by/3.0/deed.en
info:eu-repo/semantics/openAccess

 
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Creado: Sat, 30 May 2009, 12:49:24 CET