Search Results (All Fields:"objectivity", isMemberOf:"oaingeec:ing-elec-col-e986be1262dcf896f5680312.e08c816", Date:" [2006\-01\-01T00\:00\:00Z TO 2006\-12\-31T00\:00\:00Z] ")

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Monoestable disparado por flanco construido a partir de inversores lógicos. (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 178 45
Problema propuesto 8.6 (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 265 84
Circuito que permite el cambio de nivel a flanco de bajada activo de una señal. (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 244 68
Circuito biestable R-S activo al nivel bajo. (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 302 65
Asociación de sumadores con acarreo anticipado (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 595 153
Problema propuesto 5.7.4 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 197 69
Problema propuesto 5.4.8 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 235 64
Problema propuesto 4.4.2 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 180 60
Circuito lógico de un comparador de 2 bits (soluc. alternativa 3) (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 361 68
Problema propuesto 5.12 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 179 62
Descripción funcional mediante VHDL de un sumador completo (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 284 68
Problema propuesto 5.13.c3 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 216 67
Problema propuesto 5.9.4 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 201 72
Circuito biestable R-S activo al nivel bajo. (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 307 71
Problema propuesto 8.4 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 280 81
Problema propuesto 5.6.2 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 191 60
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 354 61
Problema propuesto 5.7.2 (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 199 64
Estructura interna de una unidad aritmético-lógica. Esquema del diagrama lógico. (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 333 77
Problema propuesto 4.19.1 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 201 62
Problema propuesto 5.10 (soluc. alternativa simplificada) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 216 61
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 334 52
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma Electronics Workbench 5.1 ó superior)  7.08 412 60
Problema propuesto 4.17 (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 234 64
Estructura interna del codificador sin prioridad. Codificador 8 a 3 activo con nivel bajo (I1). (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 264 70
Problema propuesto 7.3.3 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 212 61
Problema propuesto 4.6 (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 206 76
Comportamiento de una puerta lógica NOT tres entradas (tabla de verdad). (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 219 64
Circuito generador/detector de paridad CI 74180 (2º caso) (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 624 95
Problema propuesto 5.8 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 223 57
Problema propuesto 5.6.4 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 214 66
Problema propuesto 4.8 (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 242 72
Problema propuesto 4.6 (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 194 72
Problema propuesto 5.4.14 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 215 62
ADC bipolar de doble rampa simétrica de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 508 97
DAC de simple rampa de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 304 62
Problema propuesto 5.4.8 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 189 65
Problema propuesto 6.4.1 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 199 59
Circuito biestable D síncrono activo por flanco de subida. (Requiere Plataforma Electronics Workbench 5.1 ó superior)  7.08 345 68
Estructura interna de una unidad aritmético-lógica. Operación aritmética A+A·B. (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 318 72
Problema propuesto 8.1.2 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 192 60
Problema propuesto 5.6.1 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 201 56
Tablas de resultados a rellenar correspondientes a la práctica 11 (Requiere Plataforma Microsoft Word 97 ó superior)  7.08 621 155
Fuentes dependientes. Fuente polinomial. (Requiere Plataforma Electronics Workbench 5.1 ó superior)  7.08 246 66
Empleo del decodificador como demultiplexor. Tabla de verdad de un demultiplexor de 8 salidas [3]. (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 317 75
Comportamiento de una puerta lógica XOR (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  7.08 324 44
Problema propuesto 5.10 (soluc. alternativa simplificada) (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 204 63
Circuito sumador-restador de 4 bits (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 340 90
Problema propuesto 5.4.10 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 170 58
Problema propuesto 7.1.1 (Requiere Plataforma MicroCAP 9.0 ó superior)  7.08 266 67

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