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Refinar
Author Name
Santiago Emilio Acha Alegre
(36)
Adolfo Hilario Caballero
(2)
Eugenio López Aldea
(2)
Fernando Yeves Gutiérrez
(2)
Francisco García Sevilla
(2)
Published Date
2006
(36)
Collection
Set de Objetos de aprendizaje de la UNED
(36)
Set de openaire
(36)
Objetos digitales segundo curso
(36)
(36)
Escuela Técnica Superior de Ingenieros Industriales (ETSII)
(36)
Keywords
Electrónica
(36)
http://udcdata.info/042064
(36)
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma OrCAD 9.1 ó superior)
3.05
299
56
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma OrCAD 9.1 ó superior)
3.05
320
69
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma Electronics Workbench 5.1 ó superior)
3.05
419
65
Circuito para realizar el control de calidad en una cadena de producción. (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)
3.05
289
62
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma MicroCAP 9.0 ó superior)
3.05
341
71
Circuito para realizar el control de calidad en una cadena de producción. (Requiere Plataforma OrCAD 9.1 ó superior)
3.05
396
64
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..1 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
371
72
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..4 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
371
70
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos..1 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
366
62
Circuito para realizar el control de calidad en una cadena de producción. (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
302
64
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
411
83
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
372
65
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
367
65
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
385
64
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos (Requiere Plataforma Electronics Workbench 5.1 ó superior)
3.00
405
71
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
339
69
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
337
55
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos..2 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
403
74
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..2 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
368
79
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..1 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
327
73
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..1 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
340
78
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma Electronics Workbench 5.1 ó superior)
3.00
387
74
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..1 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
358
75
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
367
89
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
349
79
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
336
67
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada..3 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
367
62
Oscilador en puente de Wien con control automático de la ganancia mediante un FET (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
1034
145
Circuito para realizar el control de calidad en una cadena de producción. (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
281
49
Diseño por el método de los sistemas secuenciales síncronos de un circuito con biestables JK para que se controle una secuencia especificada. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
345
52
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..3 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
312
74
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..2 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
321
55
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
295
68
Circuito de control de una célula de memoria RAM básica, ignorando los circuitos de selección y acondicionadores de E/S de datos. (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
399
58
Oscilador en puente de Wien con control automático de la ganancia mediante un FET (Requiere Plataforma OrCAD 9.1 ó superior)
3.00
750
129
Diseño por el método de los sistemas secuenciales síncronos y con biestables JK el control de velocidad..4 (Requiere Plataforma MicroCAP 9.0 ó superior)
3.00
339
78