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Problema propuesto 5.6.1 (soluc. alternativa simplificada) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 224 65
Estructura interna del codificador sin prioridad. Codificador 8 a 3 activo con nivel alto (I5). (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 409 85
Problema propuesto 5.4.11 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 191 52
Asociación de sumadores con acarreo anticipado (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 595 153
Problema propuesto 5.7.4 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 197 69
Problema propuesto 5.9.1 (soluc. alternativa simplificada) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 201 61
Problema propuesto 5.4.8 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 235 64
Problema propuesto 4.3 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 226 61
Circuito biestable R-S síncrono activo por nivel..2 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 362 70
Problema propuesto 4.7 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 203 60
Problema propuesto 4.4.2 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 180 60
Circuito lógico de un comparador de 2 bits (soluc. alternativa 3) (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 361 68
Problema propuesto 5.12 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 179 62
Descripción funcional mediante VHDL de un sumador completo (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 284 68
Problema propuesto 5.4.5 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 273 64
Problema propuesto 5.13.c3 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 216 67
Problema propuesto 5.9.4 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 201 72
Problema propuesto 5.15.1 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 209 67
Circuito biestable R-S activo al nivel bajo. (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 307 71
Problema propuesto 8.4 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 280 81
Circuito biestable J-K síncrono activo por flanco de bajada. (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 311 79
Problema propuesto 5.6.2 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 191 60
Problema propuesto 5.5.2 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 199 54
Interfaz TTL a CMOS mediante resistencia elevadora pull-up (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 287 49
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 354 61
Problema propuesto 5.7.2 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 199 64
Estructura interna de una unidad aritmético-lógica. Esquema del diagrama lógico. (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 333 77
Problema propuesto 4.19.1 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 201 62
Problema propuesto 6.6 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 188 73
Problema propuesto 5.10 (soluc. alternativa simplificada) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 216 61
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 334 52
Estructura interna de una unidad aritmético-lógica (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 808 155
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma Electronics Workbench 5.1 ó superior)  5.68 412 60
Problema propuesto 4.17 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 234 64
Estructura interna del codificador sin prioridad. Codificador 8 a 3 activo con nivel bajo (I1). (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 264 70
Circuito biestable T síncrono activo por flanco de bajada. (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 321 90
Problema propuesto 7.3.3 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 212 61
Problema propuesto 4.6 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 206 76
Comportamiento de una puerta lógica NOT tres entradas (tabla de verdad). (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 219 64
Circuito generador/detector de paridad CI 74180 (2º caso) (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 624 95
Problema propuesto 5.6.2 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 222 74
Circuito lógico de un generador de paridad de 8 bits (segunda configuración) (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 965 143
Problema propuesto 5.8 (soluc. alternativa) (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 223 57
Problema propuesto 5.6.4 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 214 66
Problema propuesto 4.8 (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 242 72
Estructura de un biestable RS-NAND con sincronismo por nivel (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 590 161
Problema propuesto 4.6 (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 194 72
Complementador a dos (VHDL parte 3). (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 247 56
Problema propuesto 5.4.14 (Requiere Plataforma MicroCAP 9.0 ó superior)  5.68 215 62
ADC bipolar de doble rampa simétrica de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  5.68 508 97

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