Search Results (All Fields:"CAD", Date:" [2006\-01\-01T00\:00\:00Z TO 2006\-12\-31T00\:00\:00Z] ", isMemberOf:"bibliuned:Setopenaire", Display Type:"Objeto de aprendizaje")

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Problema propuesto 4.2 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 214 76
ADC bipolar de doble rampa simétrica de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 531 103
Comportamiento de una puerta lógica NOR tres entradas (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 269 52
Problema propuesto 4.18 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 227 81
Problema propuesto 4.16 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 217 68
Problema propuesto 4.8 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 220 64
Circuito biestable R-S activo al nivel bajo. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 259 59
Problema propuesto 5.9.2 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 260 68
Comportamiento de una puerta lógica XNOR (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 345 44
Problema propuesto 8.6 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 265 84
Circuito lógico de un generador de paridad de 8 bits (primera configuración) (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 622 127
Problema propuesto 5.4.12 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 197 54
Minimización de una función lógica de 3 variables (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 317 57
Circuito biestable R-S activo al nivel bajo. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 302 65
Comportamiento de una puerta lógica XOR (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 268 46
Comportamiento de una puerta lógica XNOR (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 297 54
Problema propuesto 5.11 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 215 65
Problema propuesto 5.4.11 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 191 52
Circuito biestable T síncrono activo por flanco de bajada. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 280 69
Comportamiento de una puerta lógica OR tres entradas (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 288 60
Problema propuesto 4.2 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 210 67
Problema propuesto 7.8 (soluc. alternativa 2) (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 265 69
Problema propuesto 7.1 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 241 82
Problema propuesto 4.3 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 226 61
Circuito biestable R-S síncrono activo por nivel..2 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 362 70
Problema propuesto 4.7 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 203 60
Circuito lógico de un comparador de 2 bits (soluc. alternativa 3) (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 361 68
Descripción funcional mediante VHDL de un sumador completo (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 284 68
Problema propuesto 5.15.1 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 209 67
Circuito biestable J-K síncrono activo por flanco de bajada. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 311 79
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 354 61
Problema propuesto 5.7.2 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 199 64
Problema propuesto 6.6 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 188 73
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 334 52
Problema propuesto 4.17 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 234 64
Problema propuesto 4.6 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 206 76
Circuito generador/detector de paridad CI 74180 (2º caso) (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 624 95
Circuito lógico de un generador de paridad de 8 bits (segunda configuración) (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 965 143
Problema propuesto 4.8 (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 242 72
Problema propuesto 4.6 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 194 72
Complementador a dos (VHDL parte 3). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 247 56
Problema propuesto 5.4.3 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 231 46
ADC bipolar de doble rampa simétrica de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 508 97
DAC de simple rampa de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 304 62
Circuito biestable D síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 319 55
Circuito biestable R-S síncrono activo por nivel. (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 286 68
Comportamiento de una puerta lógica OR tres entradas (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 240 46
Circuito generador/detector de paridad CI 74180 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 934 145
Problema propuesto 4.16.2 (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 226 78
Comportamiento de una puerta lógica XOR (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  3.16 324 44

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