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Introducción a la Síntesis con VHDL (4)  1.38  
Simulación VHDL con OrCAD (3)  1.22  
Riesco, F.(1970) .Diferentes entornos de apoyo para la impartición de un curso de VHDL. .En: . ()  0.95 501 1126
Descripción VHDL de sumador paralelo con acarreo de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 634 127
Circuito lógico de la expresión canónica en minterms simplificada (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 331 67
Complementador a dos (VHDL parte 3). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 247 55
Obtención de la función simplificada S y su circuito lógico (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 464 65
Circuito lógico de la función simplificada S con puertas NAND (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 308 66
Descripción funcional mediante VHDL de un sumador completo (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 598 100
Circuito lógico de la expresión canónica en maxterms simplificada (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 321 48
Complementador a dos (VHDL parte 1). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 247 49
Complementador a dos (VHDL parte 2). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 228 61
Descripción VHDL de puertas inversoras con retardos (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 338 68
Sumador paralelo con acarreo mixto (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 372 87
Obtención de la función simplificada f2 y su circuito lógico (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.95 250 51
Franco, E. y Montero, F.(1970) .Diseño del microcontrolador 8051 con módulo ensamblador- generador de ROM en lenguaje VHDL. .En: . ()  0.86 704 5553
Obtención de la tabla de verdad a partir de la expresión booleana (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.85 345 69
Parada, J.L., Pérez, S. y Raña, H.(1970) .Herramienta CAD para la autoenseñanza de VHDL.. .En: . ()  0.85 518 463
Circuito lógico con puertas NAND de la expresión canónica en maxterms simplificada (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.85 317 71
Circuito lógico con puertas NAND de la expresión canónica en maxterms simplificada (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.85 279 64
Obtención de las funciones simplificadas f1,f3 y sus circuitos lógicos (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.85 264 63
Circuito lógico con puertas NAND de la expresión canónica en minterms simplificada (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.85 303 61
Circuito lógico con puertas NAND de la expresión canónica en maxterms simplificada (VHDL). (Requiere Plataforma OrCAD 9.1 ó superior)  0.85 328 84
Bataller, M., Francés, J.V., Guerrero, J., Magdalena, J.R. y Rosado, A.(1970) .El entorno de diseño Warp2: una aproximación al lenguaje VHDL. .En: . ()  0.81 687 894
Mandado, E., Mandado, Y., Menéndez, L.M. y Valdés, G.(1970) .Sistema didáctico para el autoaprendizaje del lenguaje VHDL a partir de los bloques funcionales normalizados. .En: . ()  0.81 512 971
Blanco, N. y Carlos, J.(1970) .Libro electrónico para la enseñanza y el aprendizaje del diseño lógico con VHDL.. .En: . ()  0.81 629 1734
Acosta, A., Barriga, A., Bellido, M.J. y Valencia, M.(1970) .Aplicación del VHDL en prácticas de diseño de sistemas digitales.. .En: . ()  0.81 872 4996
Blesa, A., Catalán, C., Martínez, F., Medrano, C.T. y Serna, S.(1970) .El diseño de un procesador MIPS como guía para el aprendizaje de VHDL. .En: . ()  0.81 916 1701
Artigas, J.I., Barragán, L.A., Orrite, C. y Urriza, I.(1970) .Libro electrónica digital. Aplicaciones y problemas con VHDL. .En: . ()  0.81 1893 3940
López, J.C. y López, L.M.(1970) .El VHDL en la enseñanza de la electrónica.. .En: . ()  0.81 509 1299
Descripción funcional mediante VHDL de un sumador completo (Requiere Plataforma OrCAD 9.1 ó superior)  0.77 283 66
Descripción VHDL de sumador paralelo con acarreo de 8 bits (Requiere Plataforma OrCAD 9.1 ó superior)  0.77 242 87
Descripción VHDL de una puerta XOR de 2 entradas (Requiere Plataforma OrCAD 9.1 ó superior)  0.77 491 91
Azcondo, F.J., Brañas, C. y de Castro, A.(1970) .Orientación de la asignatura sistemas electrónicos digitales al modelado de sistemas en VHDL partiendo de esquemas matlab-simulink. .En: . ()  0.75 568 717
Cárdenas, J.C., Jiménez, D., Oleagordía, I. y Sánchez, M.(1970) .Internet en la docencia. VHDL, lenguaje de descripción de Hardware.. .En: . ()  0.75 555 435
Cerdá, J., Colom, R.J., Gadea, R., García, R., Larrea, M.A. y Martínez, M.(1970) .Desarrollo de un tutorial multimedia como apoyo a la docencia de VHDL. .En: . ()  0.75 708 329
Ruiz-Andino, A. y Ruz, J.J.(1970) .Laboratorio de estructura de computadores basados el VHDL.. .En: . ()  0.70 621 1434
Castro Gil, Manuel Alonso, López, E. y Martínez, C.(1970) .Enseñanza de componentes digitales y simulación VHDL usando IPSS_EE (Internet-based system support with educational elements). .En: . ()  0.70 534 854
Circuito sumador completo.2. (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 227 66
Comportamiento de una puerta AND de tres entradas (tabla de verdad). (soluc. alternativa) (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 277 47
Circuito biestable T síncrono activo por flanco de bajada. (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 353 47
Circuito que controla el paso de piezas de una cinta a otra. (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 329 64
Comportamiento de una puerta lógica NAND tres entradas (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 304 52
Circuito de un semisumador (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 262 57
Comportamiento de una puerta lógica NOT tres entradas (tabla de verdad). (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 284 42
Circuito semirrestador (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 230 49
DAC de 8 bits de resistencias ponderadas0 (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 173 67
Problema propuesto 6.4 (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 177 63
Problema propuesto 4.15 (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 271 58
Problema propuesto 5.8 (Requiere Plataforma OrCAD 9.1 ó superior)  0.66 252 57

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